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基于dds/sopc 的諧波信號發(fā)生器的設計,基于dds/sopc的諧波信號發(fā)生器的設計摘要這篇文章設計了一個頻率,相位和諧波比例可調(diào)的諧波信號發(fā)生器。設計的諧波信號發(fā)生器是基于直接數(shù)字頻率合成(dds)技術和一個可編程芯片的系統(tǒng)(sopc)。,介紹了dds經(jīng)典的結構和一種壓縮芯片設計。然后,dds核心與壓縮使用第二代的硬件描述語言(vhdl)來描述。作為一種提供...
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基于DDS/SOPC 的諧波信號發(fā)生器的設計
摘要
這篇文章設計了一個頻率,相位和諧波比例可調(diào)的諧波信號發(fā)生器。設計的諧波信號發(fā)生器是基于直接數(shù)字頻率合成(DDS)技術和一個可編程芯片的系統(tǒng)(SOPC)。,介紹了DDS經(jīng)典的結構和一種壓縮芯片設計。然后,DDS核心與壓縮使用第二代的硬件描述語言(VHDL)來描述。作為一種提供的是Atera Inc處理器 .,柔軟的核心和Nois II是基于嵌入式FPGA芯片 的。使用Nois II和其他模塊,系統(tǒng)設計是在一個單一的FPGA芯上的?？蓴U展性改良了很多，如集成性能,這邊文章討論了DDS的原則尤其是優(yōu)化結構的DDS核心和SOPC設計單FPGA。
關鍵詞:DDS,SOPC、諧波信號發(fā)生器、噪音
摘要
這篇文章設計了一個頻率,相位和諧波比例可調(diào)的諧波信號發(fā)生器。設計的諧波信號發(fā)生器是基于直接數(shù)字頻率合成(DDS)技術和一個可編程芯片的系統(tǒng)(SOPC)。,介紹了DDS經(jīng)典的結構和一種壓縮芯片設計。然后,DDS核心與壓縮使用第二代的硬件描述語言(VHDL)來描述。作為一種提供的是Atera Inc處理器 .,柔軟的核心和Nois II是基于嵌入式FPGA芯片 的。使用Nois II和其他模塊,系統(tǒng)設計是在一個單一的FPGA芯上的?？蓴U展性改良了很多，如集成性能,這邊文章討論了DDS的原則尤其是優(yōu)化結構的DDS核心和SOPC設計單FPGA。
關鍵詞:DDS,SOPC、諧波信號發(fā)生器、噪音
