數(shù)字頻率計

頁數(shù) 16 字數(shù) 5904

摘要

文中運用VHDL語言，采用Top To Down的方法，實現(xiàn)8位數(shù)字頻率計，并利用Isp Expert集成開發(fā)環(huán)境進行編輯、綜合、波形仿真，并下載到CPLD器件中，經(jīng)實際電路測試，該系統(tǒng)系統(tǒng)性能可靠。

關(guān)鍵詞：EDA,VHDL,數(shù)字頻率計,波形仿真,CPLD
目錄

摘要
一、 設(shè)計要求
二、 儀器設(shè)備
三、 概述
四、 測頻方案及其原理與誤差分析
五、 等精度測頻系統(tǒng)組成
六、 信號調(diào)理電路設(shè)計
七、 等精度測頻電路的軟硬件設(shè)計
八、 結(jié)束語
九、 參考文獻
十、 附錄:源程序
參考文獻
⑴ 王成華，王友仁，胡志忠，電子線路基礎(chǔ)教程 北京，科學出版社，2000
⑵ 蔣璇，臧春華，數(shù)字系統(tǒng)設(shè)計與PLD應(yīng)用技術(shù)
北京，電子工業(yè)出版社，2001
⑶李朝青，單片機原理及接口技術(shù) 北京,北京航空航天大學出版社，1999
⑷ 《中國集成電路大全》委員會 高速CMOS集成電路
北京，國防工業(yè)出版社，1995
⑸ 《中國集成電路大全》委員會 集成運算放大電路
北京，國防工業(yè)出版社，1985